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只是工业变革有时候像海啸。一个大浪打过来，旧的东西都会被冲击***。而那一波大浪就是仍在全速推进的数字化转型潮流，带动了半导体技术的不断突破，使移动网络从4G转向5G，使大数据和人工智能成为现实。这些都对计算速度和传输性能提出了更高的要求，因此作为I/O传输枢纽的PCIe3.0接口必须升级。赶上延迟的进度，加速推出PCIe5.0。

只是因为之前的升级操作搁置太久，所以停滞了近十年。如果要重启，会马上面临所有人员的困境，很多文件和流程都需要重新起草。所以这个新标准制定的进度远远落后于行业，同时也出现了需要升级两级的奇怪现象。

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PAM-4技术的使用是一个新的进展，但它还在讨论之中，并且通过0.3版的发布，还将从会员的发展中获得更多的反馈，并相应地进行调整，如果会员的反馈不理想，终还是有可能改变的。然而，速度的持续倍增并非全无缺点，的，是给系统设计者带来更大的压力，不仅需要在整个系统规划中投入更大的心力，才能在速度和稳定之间寻求平衡。而且在开发后期的测试和验证中，所需的费用也会比较大。

下一代酷睿将升级到PCIe5.0，也可能随后升级到PCIe6.0。为什么突然间升级的速度这么快？是不是我们的配饰已经过时了？各位不要慌，小编今天就来为大家介绍一下。事实上，PCIe版本的更新速度，的确不能怪Intel，因为从2010年11月PCIe3.0规范正式发布到2017年11月PCIe4.0规范正式发布，确实拖延了太长时间，而且要知道PCIe2.0和PCIe3.0之间的间隔将近4年，已经被认为是太多的波折，影响了计算机总线的发展速度，从3.0发布到4.0发布，又花了整整7年时间……所以说近PCIe5.0正式发布的时间，实际上完全是正常的，

PCIe5.0和PCIe3.0/4.0的区别是什么？重要的当然是速度了。在理论上，PCIe5.0的传输速度将会再一次翻番，每条信道达到32Gbps，这一数字你们从哪里看过没有？是的，就是在某些主板的M.2接口上，原来需要4个PCIe3.0通道接口，现在只需一个5.0通道即可完成。PCIe5.0为了保证高速传输的稳定性，还特意增加了信号完整性设计，使其不仅适用于连接显卡、SSD等配件，用于存储器和处理器的通信，而且可以用作平台总线。